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最近看到朋友对DDR1和DDR2有使用困扰,想来写个帖子,和大家交流下,欢迎大家拍砖。
$ S$ }! L/ z4 D* B {其实内存部份,在早前还有SDRAM,目前基本上已淘汰,就不再阐述了
5 \- E- R, S5 ?' L+ z1 [9 w下面来简单介绍下DDR1、2、3(先上图) , R9 H7 U- K8 u! h
至于一些其它的相关知识,网上都可以找到,就不另外说明了
; u3 m( t7 T, k7 w* f' ?) h: u$ O: H, P8 F8 i M
. X$ C/ A3 r8 T0 O2 N/ N5 m4 h; @: J. P
1、内存外观上判断:
6 p% `! p% B2 n7 }5 S8 f) G; z9 HDDR1和2和3,在PIN 金手指数不同
# I y$ Y( m1 XDDR1和2和3,在开口位置不同 ' M; Z7 D4 D, f) A& |1 I( O
0 B# _1 {4 q( `# b6 u2、内存供电电压上看:
' w8 a& h) z" t* R% BDDR1 Vcc 2.5V
, M/ S! N: w T: j4 R* p0 |' aDDR2 Vcc 1.8V (1.8~2.5V 随频率不同 电压有相应增加)
" J; Q9 p, `5 \5 v Q1 l0 ^1 `5 R9 dDDR3 Vcc 1.5V (1.5~2.0V 随频率不同 电压有相应增加)
# D& d" X: ~, O
6 c: x# }- g7 P3 C) ^! f& O/ B3、内存与北桥chipset的搭配:
( `8 _" u9 ?) Z, x0 L/ c因为现在只有在少量的很老的主板上有看到DDR1,市面上基本上都是DDR2和DDR3,所以再购买的时候,只要知道在那些北桥开始支持DDR3就可以了 & ?6 ]9 }' Q% K8 w( q
主要了解Intel和AMD(ATI)就可以了
* W0 w5 i O7 r2 m* [8 Q: p- d& z" L2 M5 n& O6 V9 Q0 P/ p
' F3 n. U3 r; Q( @$ d2 ]) S- t5 ]8 Z8 S% }
4、内存与CPU的搭配 2 g8 h$ @3 F9 D6 T
Intel:
7 _; k/ [4 a$ v& @" _LGA775 E2160 酷睿以上的开始支持DDR3/DDR2 2 [/ a7 h- Y% }, S/ ?
LGA1156 仅支持DDR3
$ g6 V" `- B% F! S. D* E% D9 O4 HLGA1366 仅支持DDR3 * L% j4 D5 a1 W
AMD: 4 x) Z& G4 d- E" E2 ^' X
AM3:同时支持DD2和DDR3
* f) K+ g) \ I3 Y2 z- M! p- HAM2/AM2+:只支持DDR2 & e! ~, p1 ]% w. e* W3 F
E2 z6 |! B0 f) p2 ?5、内存,从机种名上看 3 b* B+ J, \- z y& `/ v
一般从机种名就可以看出使用什么芯片,就可以知道是什么CPU以及什么DDR 9 R0 S& `7 h7 v8 h+ ]5 b- [
不同的主板厂商命名规则不一样,以Gigabyte举例:
9 T! j$ @8 s% Z0 NGA-P35C-DS3R & ]! V, w+ m6 _$ J% t4 }
P35+ICH9R CPU:Intel LGA775 DDR:同时支持DDR2和DDR3 (中间有带C的) , H7 ^; r/ R4 W( I; Z
GA-785GMT-USB3
y3 V( Q7 d/ kAMD 785G+SB710 CPU:AM3 DDR:只支持DDR3 (中间有带T的) " Z8 W" K5 [& I3 v
GA-P55A-UD4 ! W5 ^# P5 f5 o. r
P55 CPU:LGA 1156 DDR:只支持DDR3 + _/ T; c( P% n# m0 H4 Z
当然还有很多
# P! I; |, ]* W4 r. J. a- M% c4 X6 {
6、DDR的一些主要参数
! D- F5 X' D5 A其实内存除了不同的厂商和不同的颗粒以外,影响到其性能的主要参数如下: ! l1 m$ B- {' K" V% ?
有兴趣的同学可以在网上参阅下:
1 S8 _3 W( u& b# _/ R% N$ R" I具体到超频高手,在memory上针对下列参数的调节和电压的调节是有很大的讲究的 ; X9 u; R& K p U6 V
(tRP) - Minimum Row Precharge Time
; d( Z! C" P& m1 w; m/ P(tRRD) - Minimum Row Active to Row Active Delay
3 q. W& d U( ~. i+ c3 {) q(tRCD) - Minimum RAS to CAS Delay 4 `7 ~$ G: }7 d q, |8 Z7 Y0 r
(tWR) - Write Recovery Time
& A7 c# M) I6 m4 J5 u2 R4 q- x& X& F(tWTR) - Internal write to read command delay
* D8 @4 J; j% g+ m) d) f( J(tRTP) - Internal read to precharge command delay |
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